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) g3 ?- Y9 L0 T3 L% p随着科技的发展,技术提高产品性能要求越来越高,近几年可编程的门阵列(FPGA)技术发展迅速* g# m v' R3 ^, Q8 b
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,其高度的灵活性,使其在通信、数据处理、网络、仪器、工业控制、军事和航空航天等领域得到
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3 E/ g* H' @' T3 ]7 l越来越广泛的应用。在数字IC设计领域,前端验证工作一般都是用FPGA完成的,因此FPGA工程师也8 J7 _6 `! y' K+ |; l/ G8 X$ s0 t
* F$ b+ c* W& ?( i- ^* z是IC设计公司迫切需要的人才。 FPGA/IC逻辑设计开发已经成为当前最有发展前途的行业之一,特
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别是熟悉硬件构架的FPGA系统工程师3 _: h! r- u, U+ u2 _
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第一阶段的课程主要帮助学员了解FPGA系统设计的基础知识,掌握FPGA最小系统硬件电路设计方法
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,学会操作QuartusII软件来完成FPGA的设计和开发。
% G7 @6 V: w2 ~% ^1.可编程逻辑设计技术简介3 z, n# p" j# V! m
2.下一代可编程逻辑设计技术展望
' E% D% s. Q& c+ V3.可编程逻辑器件硬件上的四大发展趋势
9 T5 c" n' l3 X: c) A& Y4.EDA软件设计方法及发展趋势% i; P# S% N, v2 @+ z: `
5.FPGA的设计流程' Z# y/ `3 v' X# F, p- L8 U1 s
6.FPGA的常用开发工具5 a+ ?( H; ]/ o% B: R3 D( [. B
7.FPGA的基本结构+ [7 ^: k6 W- z5 O2 z) v: H
8.主流低成本FPGA Cyclone
0 x/ t1 c4 B$ U3 g" ?10.FPGA芯片的选型策略详解
) N" z0 Z: K6 @) _& B! @9 C. G11.FPGA关键电路的设计(最小电路设计):
+ d4 v- m3 S/ Y& d0 ] 11.1 FPGA管脚设计" y* I1 Q$ h4 v) G+ j! z- A2 `2 |
11.2 下载配置与调试接口电路设计
# f5 f) M; b: Y$ p 11.3 高速SDRAM存储器接口电路设计
" J; N- E4 T) U. V- m/ P 11.4 异步SRAM(ASRAM)存储器接口电路设计
, ]2 f* U# J) i, [' F9 E 11.5 FLASH存储器接口电路设计
/ b( G; F( Y+ j. Y" X* K 11.6 开关、按键与发光LED电路设计
2 r) T- X4 _3 ~* Y$ u' c4 {1 |" a 11.7 VGA接口电路设计0 V. Y. S; ~9 A5 e4 S
11.8 PS/2鼠标及键盘接口电路设计
; ~6 K+ l4 A2 {) |1 x$ o 11.9 RS-232串口2 p% p& _% }( H7 U
11.10 字符型液晶显示器接口电路设计
4 k3 C+ Y1 _9 Q6 S 11.11 USB2.0接口芯片CY7C68013电路设计$ @, n/ g; f1 Z: F
11.12 电源电路设计: M8 H( e* @9 N! O1 X
11.13 复位电路设计
# _- ?% S" y: _: G* E$ a 11.14 拨码开关电路设计
7 P2 @0 E2 a7 ^* I3 c+ ?5 I: y& w3 H 11.15 i2c总线电路设计% a+ D* u5 z! g9 k" O) |" c
11.16 时钟电路设计
V9 a. t3 A* W+ d s) Y* ^$ z 11.17 图形液晶电路设计
- q# Y: l0 g6 T. Q- h( m12.Alter FPGA的结构: h6 Y# ^2 d" Z$ j. c
- f6 U. K) @. b3 z" C第二阶段:熟练掌握硬件描述语言(Verilog HDL)是FPGA工程师的基本要求。通过本节课程的学习,
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学员可以了解目前最流行的Verilog HDL语言的基本语法,掌握Verilog HDL语言中最常用的基本语0 \, H1 J+ m/ y) y3 e
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法。通过本节课程学习,学员可以设计一些简单的FPGA程序,掌握组合逻辑和时序逻辑电路的设计) ~& N" \# X- ?2 S: U
! b. R6 U, c! C' a# J; x% f4 L
方法。通过实战训练,学员可以对Verilog HDL语言有更深入的理解和认识。
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, o+ L0 Q. Y- w) w/ y% K1.Verilog HDL语言简介0 A# W# K1 C1 Z' e# C8 B- ?
2.Verilog HDL语言逻辑系统- |* i+ L3 H( N8 S) L) p
3.Verilog HDL操作数和操作符
) X; a$ S- @, Q5 l7 F* {- P; y& Z4.Verilog HDL和VHDL语言的对比
0 w o, G _1 _; s. i! l5.Verilog HDL循环语句
' ?/ P8 C2 }3 P1 o! N/ K6.Verilog HDL程序的基本结构
, b! E5 ]. i3 k" Y B& x$ M7.Verilog HDL语言的数据类型和运算符* g% t( U$ p) S& ~/ o5 s. v
8.Verilog HDL语言的赋值语句和块语,阻塞和非阻塞赋值语句的区别
% o) u5 x/ i- f. t' y5 V9.Verilog HDL语言的条件语句,包括IF语句和CASE语句的典型应用
6 C$ H: m. ]& v. Y5 X10.Verilog HDL语言的其他常用语句+ Z& |$ m3 \' S6 x& h" l
11.Verilog HDL语言实现组合逻辑电路
* m; I) D' f% J! j9 Y12.Verilog HDL语言实现时序逻辑电路1 }- Y2 S3 I6 e' r
第三阶段
! a0 P d; X8 U3 g7 Q 虽然利用第二阶段课程学到的HDL基本语法可以完成大部分的FPGA功能,但相对复杂的FPGA系统
! p/ R, R/ A% B$ z# \9 z7 v0 K. r0 W4 A
设计中,如果能够合理的应用Verilog HDL的高级语法结构,可以达到事半功倍的效果。通过第三+ h" \, G Q2 x: r6 l% O) `# J
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天课程的学习,学员可以掌握任务(TASK),函数(FUNCTION)和有限状态机(FSM)的设计方法- q2 P7 N% e; g$ e
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,可以更好的掌握FPGA的设计技术。此外,本节课程还介绍了QuartusII软件的两个常用的高级工
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7 M$ u. o8 P. f/ o具-SignalTAP和LogicLock,可以提高FPGA设计和调试的效率。
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1. TASK和FUNCTION语句的应用场合4 B+ v% i' p6 b/ @0 `+ G- Q. u
2. Verilog HDL高级语法结构-任务(TASK)6 C( e) ~- k& a9 S$ b
3. Verilog HDL高级语法结构-任务(FUNCTION)
6 Z7 `$ _$ v! E g4. 有限状态机(FSM)的设计原理及其代码风格' J' [0 W2 T% p* N& P0 _
5. 逻辑综合的原则以及可综合的代码设计风格' b; h- S+ q* w4 M
6. SignalTap II在线逻辑分析仪使用方法9 U' r4 b. y: o
7. Logic Lock逻辑锁定工具使用技巧% V- s' ~4 E6 S" O
8 M# R2 H y, R/ Z. ?第四阶段:随着FPGA芯片的性能和密度不断提高, 基于FPGA的SOPC系统正在逐渐成熟并且在很多领
; y6 W7 S) g7 [* f! |2 V3 \& W3 F. }& }! x$ }% {
域得到了应用。第四阶段课程主要给学员介绍Altera公司基于NIOSII软核的SoPC系统设计流程和方
; x0 A2 D; f& V5 ]1 a0 K
" m# v' z$ p" F法。通过硬件开发板上的SoPC系统设计实验,学员能够体会SoPC技术给系统设计带来的灵活性。最
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后通过FPGA综合设计实验,学员完成对四天学习内容的回顾和总结。7 O* W; w7 S8 ~) j! t4 |3 N
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1. 基于FPGA的SOPC系统组成原理和典型方案
7 g0 b5 L% r. _6 d X0 j0 p2. Altera公司的NIOS II 解决方案
+ m( D2 [, ~1 C) ^" H. o( W3. 基于NIOS II的硬件系统设计流程
$ {; \+ M5 T) ?1 H: \* _. |4. 基于NIOS II的软件系统设计流程
" w$ }1 N+ m5 m# I: P5. 基于NIOS II的软件系统调试方法( Z- f L- R! s+ L' E* Y5 U
第五阶段& m. }7 [0 n/ A1 P W, T2 j7 u
Alter的IP工具
# H3 x3 V: m' R1.IP的概念、Alter的IP$ |) V* s! v/ [ n. q) E4 I
1.1 IP的概念
, ~. @! D1 _ D G6 T4 }) R1.2 Alter可提供的IP
5 A! P8 f" s& b. U1.3 Alter IP在设计中的作用
$ A7 l* L- T6 X9 Z# O2.使用Alter的基本宏功能) s' g+ }; v* K: M1 @: G; n$ i
2.定制基本的宏功能3 K8 v+ {- a% y5 Y
2.1定制基本宏功能# Q; s/ e) O5 o9 H, f) {
2.2实现基本宏功能
2 ^% K; z% E/ l2.3设计实例
7 u- A% e2 g: j/ h U% f3.使用Alter的IP核$ W1 s, [; l% R" L. z
3.1定制IP核( I% u8 I! ?3 ]
3.2实现IP核
8 b6 e0 O% g% O3.3设计实例 6 w% r, Q1 v' E
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质量保障:
1 o4 k0 u' {% y9 Q4 C每个班提供充足的实践操作和问题辅导答疑时间。保证人手一台机实验器材!
" W1 U5 u& a1 i& z+ O, S* |( _所有班级均采用小班授课(6-8)人,20%理论+80%实战实践3、在学习期间均会获得我公司研发部
5 g7 L4 L" N+ Y& D+ j9 Q5 E
' s |7 B! R1 ?/ [7 k十几位资深高级工程师、国际项目经理等的技术支持,除正常学习时间外,其他任何时间学员均可
0 u; h; E+ M! }
" S: J/ P: t- N5 P1 T( @, x前来进行额外实践, X+ E, f5 P5 u5 n8 @6 \% U
提供一年的的免费技术支持服务。
1 J; V# M9 Y7 k* D2 }% { x5 w优秀学员可以享受免费的推荐就业机会!
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* z/ b% T3 _9 J0 J我们的培训中心就在您身边:南山中心/龙华中心/沙井中心/布吉中心/龙岗中心
' c u# Z% l7 q. d更多内容欢迎交流:18925218907 qq:2859780203(何老师) + I. Q' Y5 Q) s+ o
联系地址:深圳市南山区南新路与桃源路交汇处苏豪名厦705室(地铁桃园站B出口) |
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