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随着科技的发展,技术提高产品性能要求越来越高,近几年可编程的门阵列(FPGA)技术发展迅速
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,其高度的灵活性,使其在通信、数据处理、网络、仪器、工业控制、军事和航空航天等领域得到$ D4 B1 }; F. s6 x% ]1 n3 Y2 i
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越来越广泛的应用。在数字IC设计领域,前端验证工作一般都是用FPGA完成的,因此FPGA工程师也0 |9 w) G# n* F# r0 r' |
! m) B2 Y+ X8 z: ]0 O) r是IC设计公司迫切需要的人才。 FPGA/IC逻辑设计开发已经成为当前最有发展前途的行业之一,特8 K! r8 Q/ f! }! G# H9 V
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别是熟悉硬件构架的FPGA系统工程师
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第一阶段的课程主要帮助学员了解FPGA系统设计的基础知识,掌握FPGA最小系统硬件电路设计方法) M( N" K, i8 h6 C G$ r8 Q
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,学会操作QuartusII软件来完成FPGA的设计和开发。5 a4 M- N1 C* A' M% t# L7 M, G
1.可编程逻辑设计技术简介8 T1 t( o) ~2 m; X0 B* a
2.下一代可编程逻辑设计技术展望+ T! ^2 T( C- v, u+ U6 Q3 V
3.可编程逻辑器件硬件上的四大发展趋势
7 Q# p ~! |" l4.EDA软件设计方法及发展趋势0 \. K" b; ?+ {# P; T
5.FPGA的设计流程) N" u) x% G# h" W. y
6.FPGA的常用开发工具
: B9 a% J: k9 z5 e- n% B7.FPGA的基本结构
) b' L2 {1 \% |0 K, x8.主流低成本FPGA Cyclone/ S( W: X5 K8 s W* u
10.FPGA芯片的选型策略详解/ Z" K6 Z/ Z1 p7 |) v" d \5 k
11.FPGA关键电路的设计(最小电路设计):5 q; B( S1 H, b! {+ R& R
11.1 FPGA管脚设计 i; R- Z, o; P3 Z% z
11.2 下载配置与调试接口电路设计, `3 V3 J9 W8 {; \# N0 }
11.3 高速SDRAM存储器接口电路设计
+ L& t9 b) B3 Z3 {& T 11.4 异步SRAM(ASRAM)存储器接口电路设计
6 C3 m* \- x+ }: {" f5 t3 O6 K. }! q 11.5 FLASH存储器接口电路设计
# y8 V5 W: p& r) c/ l4 Y 11.6 开关、按键与发光LED电路设计8 ?0 S! W) q4 s4 v; J7 m# A
11.7 VGA接口电路设计2 |( V& {+ n, {* d" w5 n) N4 w- Q% ]
11.8 PS/2鼠标及键盘接口电路设计! n% M0 X4 U1 T
11.9 RS-232串口
3 x, ^* @. \3 S8 c& z$ l5 v$ h% Z 11.10 字符型液晶显示器接口电路设计- R, C( I# p7 g. v! g* X h' Q- b
11.11 USB2.0接口芯片CY7C68013电路设计; T+ {* L- N/ h" A2 x$ I- P
11.12 电源电路设计* e7 g5 G, q1 f4 b
11.13 复位电路设计! o* b Z4 V M% J* _ F
11.14 拨码开关电路设计+ }" G7 R8 D" J% b
11.15 i2c总线电路设计: v* U# y9 M9 M* |' n
11.16 时钟电路设计
' z+ F# P, a+ O/ c1 _6 Y 11.17 图形液晶电路设计
$ U/ B& m0 u. K& H* i R12.Alter FPGA的结构+ e$ h; A% U. P0 m# k" H
' _: L8 L( a- _ i" `* S) S' g第二阶段:熟练掌握硬件描述语言(Verilog HDL)是FPGA工程师的基本要求。通过本节课程的学习,9 I$ X9 d6 ?% C5 t
5 Q! S$ h; ^9 X+ G4 T* {; E& ]学员可以了解目前最流行的Verilog HDL语言的基本语法,掌握Verilog HDL语言中最常用的基本语
7 L! b8 p) C4 K, Q2 `' `5 X; o: f' f4 r0 {1 G1 A1 V! o
法。通过本节课程学习,学员可以设计一些简单的FPGA程序,掌握组合逻辑和时序逻辑电路的设计6 |) \7 H. H: l% A* G" m, `& w e) D
& L2 @! S' H0 ?方法。通过实战训练,学员可以对Verilog HDL语言有更深入的理解和认识。
) W% ~1 N$ b, z" s# w % K/ R9 j" }9 W- O7 G% T/ N
1.Verilog HDL语言简介
; u4 u' ]* G4 u* E% `7 y2.Verilog HDL语言逻辑系统
( D3 y: C# e5 o5 l3.Verilog HDL操作数和操作符
' g5 K4 a/ I j I; b k1 B6 X4.Verilog HDL和VHDL语言的对比
, [: P1 v8 ~2 C: D$ }5.Verilog HDL循环语句( I, Y- f. g; u
6.Verilog HDL程序的基本结构6 a5 p8 T, I) _: d4 w$ W& t
7.Verilog HDL语言的数据类型和运算符7 a" r* b! ~+ N6 D
8.Verilog HDL语言的赋值语句和块语,阻塞和非阻塞赋值语句的区别; Y5 h1 F! H. p
9.Verilog HDL语言的条件语句,包括IF语句和CASE语句的典型应用1 m; i# e ]# V+ |8 W, e- ^
10.Verilog HDL语言的其他常用语句
( Y! A0 A0 Z5 B- I3 g2 @11.Verilog HDL语言实现组合逻辑电路
( k$ ^) @9 u, s# Z9 x$ v# S# _12.Verilog HDL语言实现时序逻辑电路; i. h1 P4 h6 x( ~& I
第三阶段
& h q3 `8 Y; z5 N5 M- i* M 虽然利用第二阶段课程学到的HDL基本语法可以完成大部分的FPGA功能,但相对复杂的FPGA系统
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设计中,如果能够合理的应用Verilog HDL的高级语法结构,可以达到事半功倍的效果。通过第三
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天课程的学习,学员可以掌握任务(TASK),函数(FUNCTION)和有限状态机(FSM)的设计方法4 v& p% u# Z# i6 `3 X
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,可以更好的掌握FPGA的设计技术。此外,本节课程还介绍了QuartusII软件的两个常用的高级工3 d+ |* O; ]7 g ~8 j, y& P
0 L/ c0 e+ A( n5 Z. v0 {, A: v
具-SignalTAP和LogicLock,可以提高FPGA设计和调试的效率。
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& j( g- Y7 ^ q# q1. TASK和FUNCTION语句的应用场合
& `' z+ A( n2 z9 {, ?+ Y2. Verilog HDL高级语法结构-任务(TASK)" [- G" Q3 O, R" e" |. j
3. Verilog HDL高级语法结构-任务(FUNCTION)
' @) [, c5 Z1 a1 }. g( m7 _4. 有限状态机(FSM)的设计原理及其代码风格2 D! v! {2 g2 i, Y/ O& Q7 a
5. 逻辑综合的原则以及可综合的代码设计风格
7 T: g. n' I% D7 ?/ J2 S6. SignalTap II在线逻辑分析仪使用方法8 F3 D, k( N# V+ u& D' T
7. Logic Lock逻辑锁定工具使用技巧
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7 {" c3 Y% x. R! D2 U( S3 P7 t第四阶段:随着FPGA芯片的性能和密度不断提高, 基于FPGA的SOPC系统正在逐渐成熟并且在很多领' P! s- G7 e" c8 R! Y/ K" O
: W" ]! @9 p {& U9 w! k
域得到了应用。第四阶段课程主要给学员介绍Altera公司基于NIOSII软核的SoPC系统设计流程和方
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* [6 c! ?; a8 _. J: y& Q法。通过硬件开发板上的SoPC系统设计实验,学员能够体会SoPC技术给系统设计带来的灵活性。最: `4 d/ I0 H6 u6 x9 `
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后通过FPGA综合设计实验,学员完成对四天学习内容的回顾和总结。
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1. 基于FPGA的SOPC系统组成原理和典型方案
" q& l" f& a( G* ~4 `; c) }2. Altera公司的NIOS II 解决方案3 |" V5 R4 O! O, _% v1 c
3. 基于NIOS II的硬件系统设计流程( k# ]' f+ U9 ]1 [0 c& K
4. 基于NIOS II的软件系统设计流程2 q# j. b6 ?$ H8 ^ f
5. 基于NIOS II的软件系统调试方法
' ^/ t) O8 H3 y4 {' c第五阶段8 \' n$ |: `8 u& E# A+ f7 |( M
Alter的IP工具, C$ ?6 z# o' n7 \. l9 a+ b4 T
1.IP的概念、Alter的IP; h% v7 t7 K* U; T t" m8 D
1.1 IP的概念
; _( p: y* C" n, S( V6 b1 ~1.2 Alter可提供的IP
# _$ v5 e1 H) ]+ }, S5 O1.3 Alter IP在设计中的作用
# o1 ~- h) H6 w2.使用Alter的基本宏功能# d! u3 m% v* o) }2 l8 H( H' i
2.定制基本的宏功能2 h) s1 ?' F5 C
2.1定制基本宏功能
$ S# X( Q# f# g7 s5 L, ^2.2实现基本宏功能
5 `% y* x% A& J0 J1 W2.3设计实例
$ Z8 |% B. J8 N: _3.使用Alter的IP核6 _- C; t4 a: L4 W# K i
3.1定制IP核
' I% p6 D. S8 Z' |3.2实现IP核
" X$ E2 F) Y) b3.3设计实例
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质量保障:
) M: c, T& d* @0 K; F每个班提供充足的实践操作和问题辅导答疑时间。保证人手一台机实验器材!1 s6 X+ P6 a- L$ \ ^
所有班级均采用小班授课(6-8)人,20%理论+80%实战实践3、在学习期间均会获得我公司研发部
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十几位资深高级工程师、国际项目经理等的技术支持,除正常学习时间外,其他任何时间学员均可6 s0 }+ {! t* d
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前来进行额外实践
M+ B: v5 |. y# L' V, P提供一年的的免费技术支持服务。
' {; I1 o2 E: z# D; q2 X' J0 `- D优秀学员可以享受免费的推荐就业机会!
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9 M3 G$ v" F# {! A% w/ l我们的培训中心就在您身边:南山中心/龙华中心/沙井中心/布吉中心/龙岗中心
2 H) r- j: ^3 B6 k更多内容欢迎交流:18925218907 qq:2859780203(何老师) + p8 [& d7 x! x) T
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